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System Architecture
System Architecture
This section describes the processor’s configuration on the EZ-Board
( Figure 2-1 ).
2 MB
32 MB
4 MB
Ext
SRAM
(1M x 16)
SDRAM
(16Mb x 16)
Flash
(4M x 16 )
25 MHz
Oscillator
Clock
Test Point/
Crystal
Jumper
External
Port
CLK
ADM708
Reset
WDT
Supervisor
ADM1032
DSP
Reset
ADSP-21489
Processor
MP
JTAG
IN
400 MHz
176-lead LQFP
MP
SPDIF
JTAG
IN
SPDIF
CIRC
I2C
DAI
DPI
OUT
SPDIF
OUT
Stand
AD1939
CODEC
PBs/
LEDs
SPI
Flash
16Mb
ADM3202
Alone
Debug
Agent
Mic
In
Aud
In
(4)
Head
Out
Aud
Out
(8)
RS232
CONN
JTAG
CONN
DAI
DPI
Sharc Expansion Interface II.
DAI = 0.1" Header
DPI = 0.1" Header
Ext. Port = High Speed Conn.
5V
PWR
IN
Power
Regulation
3.3V (Adjustable)
1.1V (Adjustable)
Ext. Port
Figure 2-1. EZ-Board Block Diagram
The EZ-Board is designed to demonstrate the ADSP-21489 SHARC pro-
cessor capabilities. The processor runs at 400 MHz and has an I/O voltage
of 3.3V. The core voltage of the processor is 1.1V.
2-2
ADSP-21489 EZ-Board Evaluation System Manual
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